martoni a écrit 602 commentaires

Ils mettent un exemple sur la page du projet pour faire un filtre vidéo (sobel) pour détecter les contours d'une image en temps réel :
https://www.crowdsupply.com/xips-technology/fireant/updates/awesome-sobel-filter-demo-with-fireant

Je ne suis pas sur que tu puisses faire ça avec un micro (en tout cas un microcontrôleur «low-cost»).

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C'est intéressant, ça se programme sous Linux d'après ce qu'ils mettent.

Yèp

Cependant il faut les logiciels "Efinity IDE with Verilog HDL" qui sont eux payant et excessivement cher à ma connaissance (peut-être existe t'il une version démo/étudiante?)…

Je ne connais pas le prix de la version «commerciale» par contre ils donnent une version si tu as un kit de développement. Et ce kit entre bien dans la catégorie. Le type me l'a assuré.
C'est assez classique «dans le milieu» : pour les petits FPGA une version gratuite de l'IDE est fournie.

J'aurais aimé une compatibilité "native" (disons garantie) GHDL.

Alors, GHDL est un «logiciel» (plutôt un compilateur mais passons) de simulation pour le langage VHDL.

En ce qui concerne le VHDL, il est bien supporté par leur logiciel. En tout cas il apparait bien dans les menus de configuration de l'IDE.

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Il y a cette présentation également.

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Pour celles et ceux qui voudraient aller plus loin dans le sujet, je vous recommande chaudement sa conférence à l'ORConf de 2017 (OpenRisc Conference):

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Je viens de voir cette réponse.

Ok, je note pour la prochaine fois. Y a-t-il moyen de préciser le message d'erreur pour dire «lien trop long» plutôt que «une erreur s'est produite.» ?

Merci.

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Ça y est j'ai trouvé la solution pour intégrer wavedrom à un document libreoffice.
Sans même avoir à écrire d'extension.

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Qui a dit qu'open-source signifiait gratuit ? Et à 20k$ t'iras pas pinailler sur les frais de ports je pense ;)

Plus sérieusement, les 20k$ se sont surtout des frais d'init. Si on en produit 1 millions ça sera moins cher que 1€ l'unité (en fonction de la surface utilisée à 180nm tout de même).

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Ce circuit n'est pas un ASIC (Application Specific Integrated Circuit) mais plutôt un ASSP (Application Specific Standard Product)

C'est du pinaillage de haut vol ;) Il n'y a déjà pas grand monde à comprendre ce que c'est qu'un ASIC mais si en plus on fait la différence entre ASIC et ASSP on risque de perdre tout le monde.

Maintenant, le fait que ce soit un cœur Risc-V est un réel pas en direction de l'open-hardware.

Yèp.

Il ne reste qu'à le monter sur une carte au format Arduino et à l'intégrer dans l'IDE du même nom. À quand le financement participatif ?

J'attends avec impatience le lancement d'une telle campagne de financement ;)

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C'est exactement ça 2PetitsVerres.

Un ASIC sera plus performant niveau consommation électrique et fréquence d'horloge (modulo la finesse de gravure). De plus il faudra moins de silicium pour réaliser la fonction (puisque seul les fonctions utilisé sont «gravé»).

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Je suis impatient de développer avec et pour le Raven! Je vois qu'il existe déjà une chaîne de développement pour GCC, basés sur Risc-V RV32! D'après la page sur Github, je ne devine la présence que d'un seul timer, est-ce correct? Ou bien en possède-t-il d'autres?

C'est pas sûr qu'il y ait une production de masse. Le but du Raven est surtout de faire la pub de la plate-forme de développement collaboratif eFabless.
Mais s'il est possible d'avoir un chip, je suis également impatient de pouvoir jouer avec ;)

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Ça n'est pas ma question, j'aime bien wavedrom et je voudrais pouvoir m'en servir directement dans mes documents Libreoffice.

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En tout cas, si quelqu'un à une piste ou connais bien libreoffice pour faire un plugin wavedrom je suis preneur ;)

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Allez je pose la question : Si le clavier est «fait maison», pourquoi l'avoir fait en quinconce ? Alors qu'on sait que c'est complètement anti-ergonomique.

Pourquoi ne pas avoir fait un clavier orthogonal ?

Perso je n'utilise que des typematrix car je n'arrive pas à trouver d'autre clavier orthogonaux , et c'est bien dommage car la qualité du typematrix n'est pas si bonne pour un usage intensif.

Il y a bien l'ergodox, mais j'ai un peu de mal à m'y adapter (et c'est encore plus cher que typematrix ;) )

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Au contraire, je trouve ça très bien qu'il y ait de la diversité dans les opinions. Avec le mode de scrutin proportionnel les «petites idées» peuvent vraiment avoir voix au chapitre.
Perso je raye d'office tous les «grands parti nationaux» pour allez voir les idées des petits partis.

C'est l'élection que je préfère, parce qu'il y a vraiment de la diversités.

Bon après je vais quand même éviter le parti nationale socialiste (oui oui regardez bien les slogans du parti de la reconquête) et consanguins (c'est bon on a coupé la tête du roi c'est fini). Godwin quand tu nous tiens ;)

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J'avais compris plutôt Analog to Digital Converter perso !

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Du coup si un admin peut corriger la dépêche ça serait sympa.

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Du côté des RISC le support pour l'audit est là.

RISC est juste un type d'architecture de processeur, une philosophie consistant à réduire le nombre d'instructions et à les simplifier. ARM et MIPS sont des RISC par exemple.

Par contre Risc-V (nommé riscv dans le kernel, se prononce risque failleve) est un nouveau jeux d'instructions de type RISC qui est désormais disponible dans le noyau Linux et supporté officiellement.

Risc-V est la révolution libre des processeurs ;)

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Le propos de l'article est que justement l'ouverture s'améliore pour certains FPGA.

Ça s'améliore mais c'est pas à l'initiative des constructeurs au contraire !

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Je ne sais pas ce que ça vaut pour les romans photos, mais krita est utilisé pour faire de la bd.

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Supers journaux nonobstant, il faudrait les compiler dans une dépêche ?

J'ai essayé 3 fois de la publier en dépêche, mais j'ai une erreur oops de linuxfr :(

"Le paysan-développeur ensemence son champs avec un fichier nommé «bitstream»."

C'est confusionnant au possible.

Avec le recul c'est vrai que c'est un peu confusionnant, c'était pour faire écho à la traduction littéral de FPGA : Field Programmable Gate Array ;)

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L'utilisation en «émulateurs hardware» est loin d'être la première application des FPGA.
On peut avoir par exemple :

• Adaptation de périphériques «custom» dans un système embarqué. Certain composant ont des bus de communication non standard, ou nécessite un décodage d'adresse spécifique. Un fpga est parfait pour ça.
• Ajout de périphérique supplémentaire. Toujours dans le cas de système embarqué, s'il est nécessaire d'avoir une vingtaine de bus série (uart) par exemple il est très difficile de trouver un processeur sur le marché permettant de faire ça. On peut par conséquent les ajouter dans un FPGA. Par exemple, les cartes d'armadeus munies d'un processeur i.MX sont couplées à des FPGA pour les rendre plus flexibles sur les périphériques.
• génération de signaux, un fpga est tout indiqué quand il s'agit de générer des PWM par exemple au d'autres signaux plus ou moins périodique (pour les écran d'affichage par exemple)
• Traitement vidéo/signal : beaucoup de FPGA possèdent des multiplieurs câblés ainsi que des blocs de ram intégré. Ce qui permet de faire du calcul/traitement massivement parallèle et reconfigurable à loisir en fonction de «filtres» que l'on souhaite appliqué. La plupart des caméras très haute résolution ou rapide possède des fpgas pour le traitement.
• Les antennes relais GSM utilisent massivement des fpga pour adapter le décodage des modulations de fréquences.
• simple décodage logique: les petits fpga (souvent des CPLD d'ailleurs) peuvent être utilisé en lieu et place de quelque portes logique soudées sur pcb. Si l'on a besoin de générer/décoder du manchester par exemple, ou pour faire une machine d'états pour gérer les modes d'un boutons/led.

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RISC-V et MIPS proviennent du même terreau de Berkley. Ce qui change c'est la date de conception, RISC-V est plus récent et a pu apprendre des erreurs de MIPS (ainsi que de ARM d'ailleurs).

Je comprend pas vraiment l'argument de la sécurité, en quoi le RISC-V apporterait ou non de la sécurité ?
Au contraire d'ailleurs le fait d'avoir une ISA ouverte ne peut-être qu'un plus au moins niveau logiciel.

Avec RISC-V il y a vraiment une volonté de mettre le plus possible d'acteurs du processeur autour de la table pour optimiser l'isa au mieux (par le biais de la fondation). C'est d'ailleurs la raison pour laquelle tout le spectre de l'ISA n'est pas encore stabilisé (Les base RV32E, RV128, et une partie des extensions ne sont pas encore dans leurs version final).

Et MIPS a été poussé à l'opensource par RISC-V justement.

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C'est le projet LSA, ils ont déjà fait une présentation à la conférence ORCONF2018 en Pologne. J'ai hâte de voir sur quoi ça débouche !

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Dire que Risc-V n'a pas la faille est discutable. La faille (meltdown et spectre) dépend de l'implémentation du jeux d'instructions et non du jeux d'instruction lui même.
En gros ces deux failles sont liées à la capacité des processeurs moderne à pouvoir réordonner les instructions assembleurs «à la volée» pour accélérer l’exécution (out-of-order execution).

C'est un peu comme dire que le C à des fuites mémoire et des erreurs de débordement de buffer !

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La campagne de dénigrement d'ARM n'as pas été un échec mais une bourde. Ils n'ont pas mis de temps à virer leurs site internet d'ailleurs, ils ont assez vite compris leur erreur.

Dans ce genre de cas la «bonne» manière d'aborder le concurrent est de l'ignorer, surtout pas en parler, encore moins le dénigrer ! En tout cas pas quand on est déjà en position dominante.

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